关于这个问题,是的,verilog阻塞赋值是等待右式计算完毕后再进行赋值操作。阻塞赋值会在语句执行完毕之前阻塞,直到右式的计算完成并将值赋给左式。这种赋值操作可以用于需要按顺序执行的语句中,确保每个语句都按照正确的顺序执行。
verilog阻塞赋值是等待右式计算完毕吗
投稿:醉余生
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发布时间:2023-10-01 08:32:49
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